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强强江、郭Yuanjun Zhile杨,郑,东胜阳,项羽, ”提高鲸鱼的性能优化算法通过OpenCL-Based FPGA加速器”,复杂性, 卷。2020年, 文章的ID8810759, 15 页面, 2020年。 https://doi.org/10.1155/2020/8810759
提高鲸鱼的性能优化算法通过OpenCL-Based FPGA加速器
文摘
鲸鱼优化算法(WOA),称为小说自然群优化算法,说明优势在处理全球连续优化问题。然而,它的性能恶化,当应用于大规模复杂问题由于迅速增加巨大的计算任务所需的执行时间。基于交互在人口,WOA自然是适合并行性,促使一种有效的方法来减轻顺序WOA的缺点。在这篇文章中,现场可编程门阵列(FPGA)作为一个加速器,的高级综合利用开放计算语言(OpenCL)作为异构soc的通用编程范式。平台之上,小说并行框架WOA名叫PWOA。拟议的框架包括两个可行的并行模型称为部分平行和all-FPGA平行,分别。实验是由CPU上执行WOA和PWOA OpenCL-based FPGA异构平台,解决十个著名的基准函数。与此同时,其他两种经典算法包括粒子群优化(PSO)和竞争群优化器(方案)是采用比较。数值结果表明,该方法实现了一个有前途的计算性能加上高效优化相对大规模复杂问题。
1。介绍
群优化或进化算法演示了他们的广泛的科学意义和实际问题1- - - - - -5]。近年来,越来越多的研究的重点是多目标问题和人工智能6- - - - - -9]。鲸鱼优化算法(WOA),提出了一种新颖的基于群智能的metaheuristic算法,Mirjalili和刘易斯在2016年(10]。特殊的狩猎行为的启发,座头鲸,WOA显示更好的性能与一些现有流行的方法和伟大的研究受到了人们的关注。通常,阿卜杜拉·巴塞et al。11)综合WOA与当地人搜索策略应对置换流水车间调度问题。Mafarja和Mirjalili12)提出了一个混合WOA与模拟退火特征提取。Aljarah et al。13]介绍了WOA-based教练训练多层感知器(MLP)神经网络。此外,也有研究机构使用WOA试图解决其他多样的问题,如多目标优化(14- - - - - -16),图像处理17- - - - - -19,软件测试20.)和电力系统应用程序(21,22]。
然而,大规模、多约束和复杂的场景通常出现在实际工程优化问题,如作业车间调度、混合单位承诺问题,自动路径规划。此外,高需求的反应速度和实时性能时需要满足上面解决问题。在这种情况下,大多数优化算法包括WOA可能会困在执行困境。随着问题的规模和复杂性的增加,WOA的执行时间将迅速增加,从而导致时间性能恶化[23]。WOA固有的并行性,可以解决上述问题通过应用并行算法开发出针对特定平台加速。近年来,专家学者都试图实现各种群优化算法采用最先进的技术,如多核(消息传递interface-MPI OpenMP),分布式(MapReduce,火花),和异构computing-based并行平台(图形处理unit-GPU, FPGA)。
异构计算指的是使用专用的硬件设备和不同的体系结构来执行耗时的任务,平衡CPU的计算负载。GPU是经典的并行计算设备,广泛应用于图形可视化、图像/视频处理、科学计算、深度学习等等。然而,增加部署的GPU,能源消耗和散热系统扩展已经成为严重的局限性,以及给人类社会带来沉重的环境压力(24]。鉴于这一点,一些研究者开始选择其他硬件设备由GPU来缓解压力。FPGA,小说平行加速器,拥有强大的并行计算能力和灵活的可编程性,同时保持低功耗的优势(25]。然而,传统的FPGA设计缺陷的高开发难度和时间消耗。最近,英特尔为软件用户提供了一个开发工具包,使FPGA上部署OpenCL程序成为可能。因此,开发人员可以快速实现fpga异构应用程序通过OpenCL API从而减少开发成本和上市时间。
本研究提出了高性能并行WOA (PWOA),在FPGA实现有效地解决大规模复杂优化问题。更具体地说,并给出了本文的主要贡献如下:(1)一种新型异构并行框架基于FPGA OpenCL-based WOA的加速器。(2)两个有效的模型包括部分并行模型和all-FPGA并行模型,设计程序流和数据流分析。(3)与十几个不同的数值实验进行选择的基准函数。通过比较与顺序WOA CPU上执行,该PWOA基于两个并行模型达到更高的执行性能。
本文的其余部分组织如下:部分2代表一个实质性的文献综述对探索并行优化算法。WOA理论和OpenCL-based FPGA异构平台是加速介绍部分3。部分4描述了FPGA的实现提出了PWOAs与两个并行模型,其次是实验结果和统计分析部分5。最后,给出了结论部分6。
2。相关工作
群优化算法包括WOA遇到挑战,优化性能降低由于广泛的计算成本时解决高维问题和复杂的数学模型。为了克服这些挑战,研究人员在各种平台上并行蜂群算法设计与实现。近年来,分布式和并行粒子群优化(PSO)已经实现了。一些研究[26- - - - - -30.]应用GPU并行化算法,提出不同的并行策略。Hajewski和奥利维拉31日支持缓存)开发快速并行PSO依靠OpenMP。蚁群优化(ACO) (32)和人工蜂群(ABC) [33)也通过GPU并行。关于头脑风暴优化(BSO)、金和秦34马]提出了基于gpu的方式同时et al。35)提出了并行BSO对关联规则挖掘算法基于火花框架。类似的作品(36,37使用GPU和FPGA加速遗传算法(GA)。值得注意的是,加西亚et al。38]实现的并行实现和比较教学优化(TLBO)和Jaya基于许多核心GPU。至于WOA,哈利勒et al。39)提出了一个简单的和健壮的分布式WOA使用Hadoop MapReduce,到达一个有前途的加速。
它可以得出结论,有几个典型的类型的并行技术包括OpenMP, MapReduce,火花,和异构体系结构基于专用加速器,GPU和FPGA等。GPU成为流行的通用并行计算的发展中通过GPU并行群体智能算法已经成功地获得了显著的性能改进(40]。最近,FPGA正逐渐应用到异构计算和算法加速基于OpenCL,得益于其high-parallelism,更好的能源效率,和灵活的可编程性41- - - - - -44]。实验(45)表明,蜂群算法在fpga实现一个更好的比多核cpu和gpu加速。然而,设计一个算法加速器不是一项容易的任务。在FPGA实现CPU-oriented代码很少增加性能,甚至降低了CPU的性能比较。因此,它不仅需要数字设计专业知识而且软件技能形成适当OpenCL代码(46]。
很少有研究调查在群优化算法的FPGA实现,尤其是WOA。我们之前的工作(47]探索WOA基于部分并行方案和FPGA异构平台上部署它。使用经典的基准,实证结果证明了提出的间接推动methology执行性能和收敛速度。本文由先前的研究动机,小说PWOA场景有两个通过FPGA并行模型包含进一步的利用。同时,更多样的基准用于验证的有效性PWOA基于FPGA并行框架及其计算性能对于大规模复杂问题。
3所示。鲸鱼优化算法和加速平台
3.1。基本WOA算法
WOA算法构成两个主要阶段,开发和探索,通过模拟环绕萎缩,bubble-net攻击,寻找猎物。下面的内容将详细解释每个阶段的数学模型。
3.1.1。开发阶段(环绕和Bubble-Net攻击)
第一座头鲸捕杀猎物,识别猎物的位置和包围他们。收缩包围的数学模型由以下方程: 在哪里是位置向量,代表的位置到目前为止,获得的最佳解决方案显示当前的迭代的数量,表示绝对操作,是指中的元素的乘法。和两个参数,计算如下: 在哪里通过迭代线性减少从2 0(在开采和勘探阶段)和一个随机数在吗 。的价值通过计算 ,和是迭代的最大数量。
在开发阶段使用另一种方法是螺旋更新位置,在配合上述收缩包围了座头鲸的bubble-net攻击策略。数学方程如下: 在哪里是一个常数确定对数螺线的形状和吗一个随机数在吗 。环绕萎缩和螺旋更新位置同时在开发阶段使用。数学模型如下: 在哪里是一个随机值 即50%的概率选择收缩包围法或螺旋形机制优化过程中更新鲸鱼的位置。
3.1.2。探索阶段(寻找猎物)
除了开发阶段,随机搜索技术也采取了提高勘探WOA。与剥削,一个随机的鲸鱼从群体中选择浏览搜索空间,从而找到一个更好的最优解(猎物)比现有的一个。这个阶段可以有效地防止算法陷入局部最佳状态停滞。随后,基于参数 ,的决定机制用于更新鲸鱼的位置。探索了如果 ,与此同时,如果 。优化过程数学描述如下: 在哪里是一个随机的位置鲸鱼从当前人口和选择通过方程计算(4)。
算法1介绍了WOA的伪代码。初的算法,生成初始随机人口,每个个体被健身功能和评价是目前最好的解决方案。然后,该算法反复执行,直到满足停止条件。在每个迭代中,搜索代理更新他们的位置根据随机选择的个体当 ,或者到目前为止获得的最优解 。根据 ,WOA算法决定是否使用圆形或螺旋运动。
3.2。OpenCL-Based FPGA异构计算平台
3.2.1之上。OpenCL和FPGA
OpenCL,由Khronos组织是一个开放标准的通用并行计算(48]。各种硬件设备,如CPU、FPGA GPU, DSP,实现高效的支持和并行算法在异构计算平台。此外,OpenCL指定 - - - - - -软件开发人员编程API为基础上的便利。一个典型的OpenCL程序包含主机和内核部分。
FPGA是一个可配置的集成电路,可以反复重新配置来执行大量的逻辑功能。它通常包括可编程核心逻辑,层次可重构互联,I / O元素,内存块,和需求方。与这些实质性的逻辑资源,FPGA实现增加编程的灵活性相比,专用集成电路(asic)。然而,传统的开发流程在FPGA严重依赖于寄存器传输级(RTL)描述如Verilog和高速集成电路硬件描述语言(VHDL),所开发和验证成本高。为了解决这个问题,英特尔和Xilinx FPGA供应商如发布OpenCL-based开发流程,简化了软件开发人员设计FPGA的应用程序,使这一过程更有效率。
3.2.2。英特尔对OpenCL FPGA SDK
OpenCL的英特尔FPGA SDK (49)允许开发人员创建和OpenCL高级FPGA实现。这个SDK生成一个异构计算环境中OpenCL内核编译,阿尔特拉离线编译器在运行时(AOC)编程的FPGA。在这种范式,英特尔达到优化设计而隐藏了底层硬件细节的FPGA。随后,FPGA已逐渐被应用于广泛的领域,如图像和视频处理42,50),深度学习51- - - - - -53),和智能优化算法(46]。
OpenCL-based FPGA逻辑框架见图1几个模块具体解释如下:(1)内核管道:整个框架的核心模块,它是一个实现特定的功能。AOC内核代码编译通过离线优化编译器和将被合成到高度并行逻辑电路FPGA的内部结构。(2)处理器:主机处理器通常CPU,用于控制程序运行在FPGA器件。(3)DDR:片外存储器,包括全球和常量内存OpenCL内存模型。英特尔气旋V上下文中使用FPGA器件有一个容量为1 GB的DDR3。默认情况下,不断的缓存大小是16 KB和可以修改按照实际需求。(4)PCI-e:高速数据交换接口,负责运送主机和设备之间的数据和指令。(5FPGA的片上内存:内存设备,相当于本地和私有内存OpenCL内存模型。小容量但高速,它主要用于存储输入和输出临时数据,减少全局内存的访问。因此,我们可以利用片上内存来提高OpenCL程序的效率。(6本地内存互连:执行单元和内存之间的桥梁。(7)外部存储器控制器层和物理层:控制器负责通过DDR控制数据的发送和接收。
4所示。基于FPGA的并行鲸鱼优化算法
与上面的描述和定义,WOA的框架可以概括为左边的流程图如图所示2。同时请注意,正确的WOA流程图是一个简化的框架主要由初始化,群更新、健身的计算,和群评估。类似于其他群优化算法,WOA不可避免地遭受这个缺点耗时的操作,比如更新群和计算健身,大大限制了其执行速度(45]。由于天然的并行性,利用实现的组件群更新和健身计算WOA可以并发执行。群内更新阶段,寻找鲸鱼的位置分别更新相应的移动机制,更多的生物模拟一个真正的狩猎的过程。剩下的两个阶段,初始化保持主要意识形态在这个工作对计算性能几乎没有影响,而评价是同步的,不能平行。
本节将提出基于FPGA并行WOA异构计算平台。以达到有效的加速度,WOA的一些计算密集型任务需要转移到FPGA的并行执行而CPU执行剩下的任务。并行模型可分为局部平行all-FPGA并行,将不同的任务分配给CPU和FPGA。下面是PWOA实现中,在两个方面:描述程序流程设计和数据流分析。
4.1。初始化
初始化主要是准备WOA的基本数据需要在整个阶段,包括生成随机数和初始种群。这个过程是在WOA的开始阶段,只执行一次。除此之外,C / c++为随机数生成应用专用的图书馆OpenCL不支持本地随机数生成器。在这篇文章中,一个通用的方法,将计算任务的初始化在CPU,采用进这两个提议并行模型,以充分利用计算从CPU马力。
随机数生成WOA是一个至关重要的组件。一方面,鲸鱼的初始种群是由一个随机位置。需要确保是随机位置的值必须是决策变量的范围内根据特定的目标函数。另一方面,有一些随机数作为系数( ,和 )更新鲸鱼的位置,在优化性能起着重要作用。此外,这些系数出现在每一次迭代,这意味着FPGA和CPU之间的数据传输也出现在每一次迭代。它将成为瓶颈的运行速度PWOA由于频繁的FPGA和CPU之间的数据传输。缓解这个缺点,所有必需随机数的生成初始种群在CPU身边,然后发送到FPGA一旦通过OpenCL全局内存。该方法可以显著减少PWOA的时间开销。
4.2。部分并行模型PWOA
4.2.1。准备程序流程设计
部分并行模型执行几个并行算法部分涉及所谓的master-slaves模型。部分并行模型PWOA (PWOA-PPM)给出了FPGA在图3。
主程序流程。主程序的CPU上运行,进行初始化PWOA和转移相关基本数据内核通过OpenCL全局内存。由于同步的限制,群评价放在CPU顺序执行在这个模型。之后,主程序维护的基本框架WOA将任务分配给FPGA,读取从FPGA计算结果,并评估群在每个迭代中。评价结果也发送到FPGA当主机程序利用任务命令在FPGA驱动内核函数执行。这样的任务分配可以更好地利用CPU的处理能力但相应地导致CPU和FPGA之间额外的通信开销。
内核程序流。FPGA器件用于部署内核程序和加速它。主机可以卸载计算密集型任务到FPGA的并行计算。基于OpenCL的编程模型,并行算法的部分被映射到内核函数执行线程独立(或工作项目)(40,45]。在提出的模型中,采用细粒度策略,其中每个线程负责一个个体,计算健身和更新的位置。根据系数(和 ),每个线程(个人)同时执行不同的机制:萎缩的环绕,螺旋更新,或者随机搜索。一旦内核程序执行完毕,最终结果是写回到全局内存。
4.2.2。主机和内核之间的数据流分析
在提出的实现中,主机之间的数据流和内核主要取决于全局内存带宽。在主人身边,内存缓冲区的创建和使用的数据映射到这些缓冲区,这将进一步通过PCI-e发送到全局内存的内核。在内核中,每个线程是一个基本的处理元素,从全局内存读取数据并完成核函数。如图4,数据集包含所有搜索代理的立场和健身,全球最适条件 ,和系数( 和 )。一个街区的“位置”内存块和“健身”内存块是多维的鲸鱼个人位置信息和健身价值,分别。在“系数”内存块,所有系数所需的鲸鱼在整个迭代都存储在一个街区,而“最佳状态”内存块拥有全球最好的鲸鱼的位置。
4.3。All-FPGA PWOA为基础的并行模型
4.3.1。程序流程设计
在all-FPGA并行模型,大多数WOA的组成部分,除了初始化,移植到FPGA。All-FPGA并行模型PWOA (PWOA-AFPM)设计如图5。
主程序流程。在主人身边(CPU),类似于前面的部分并行模型,主程序进行初始化WOA和相关基本数据转移到内核通过OpenCL全局内存。然而,它不再控制WOA并行模型的基本框架,使CPU负载相对较低,同时为FPGA计算开销更大。完成上述两个操作后,主机程序利用任务命令来启动内核程序的FPGA,最后从全局内存读取结果。戏剧性的设计,与部分并行模型相比,是CPU和FPGA之间通信开销最小。
内核程序流。在这个模型中,内核程序运行在FPGA变得比以前更复杂的模型。除了接收数据和写作结果返回给全局内存,进化框架,其中包含群更新健身计算和群体评价,是由内核。同样,细粒度模型也适用于使多个线程并行执行内核函数。然而,关心应采取在评估群因为所有线程共享一个全局最优解。确保算法的准确性,我们定义内存线程对内存一致性栅栏(54,55]。如图5执行,过程中红色虚线为同步器,不仅所有线程之前达到同步状态这一过程,但是也可以使用一个更好的解决方案获得的任何线程来代替全局最优的解决方案是一个原子操作。通过这种方式,所有线程可以执行,因此保证了评估结果。
4.3.2。主机和内核之间的数据流分析
在这个模型中,主机和内核之间的数据流包括全局内存和芯片级内存(本地内存),呈现在图6。同前面的模型,通过全局内存位置和系数是传播。将最终结果从内核到主机,它还需要全局内存来存储这个变量。因此,创建一个内存缓冲区,主程序开始时,要求全球全球最佳状态的内存空间 。使用FPGA的片上存储器是一个明显的变化之间的数据流模型和先验模型见图4。这是因为大多数业务WOA由FPGA执行,这是一个合理的策略利用片上内存由本地内存和私有内存。此外,这种记忆可以直接和有效地请求过程中执行内核。因此,中间结果,如最适条件和所有个人的健身,存储到本地内存中。此外,一个更高效的同步评估过程也受益于本地内存中的数据集。
5。数值实验和分析
5.1。实验装置
实验平台包含两个主要的硬件设备:CPU和FPGA。CPU平台,英特尔酷睿i5 - 8250 CPU和16 GB的RAM,而FPGA平台,英特尔FPGA气旋VGT与使用1 GB DDR3 SDRAM和64 MB。整个开发环境是基于Ubuntu 14.04 LTS和英特尔FPGA OpenCL 17.1版本的SDK。
摘要十一般基准函数(56),表中列出1串行WOA之间,用于制造性能比较(CPU实现)和两个平行模型基于PWOA (FPGA实现)。在这些基准测试函数, 单峰函数而 多峰函数。
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关于规范中的其他参数WOA算法,系数spiral-updating模型是整个评价过程中保持不变并设置为1.0。维度包括 为优化测试设置,WOA的人口规模是动态尺寸大小的两倍。验证的性能提出PWOAs,其他两种典型算法,算法(57)和竞争群优化器(方案)58),进行比较选择。此外,与特定的维度设置,每个实现30独立运行和平均性能被认为是执行。为每个独立运行的最大数量(FEs)将健康评估 ,在哪里是搜索维度的测试函数。
5.2。在基准函数优化结果和运行时间
通过使用三个woa与不同的方案和两种最先进的算法来优化10基准函数,可获得实验数据表中列出2- - - - - -5,在那里和将优化结果的平均值和运行时间30分。
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基于以上表中给出的数值,它可以注意到,WOA和PWOAs由两个平行模型(PWOA-PPM和PWOA-AFPM)目前解决问题的效力高于方案和算法优化所有基准测试函数和几个维度。至于意味着结果的所有10个测试用例,WOA和拟议中的PWOAs获得更准确的值,与其他两种算法。当优化 , , , ,和 ,WOA PWOAs保持微小差距的结果与最优值(0)。该算法,特别是可以收敛到一个理论上的最优值( )为和在任何规模。方案可以得到更可靠的解决方案 , , ,和 ,然而,仍低于该算法精度。相对而言,算法不收敛于一个精确值对于大多数基准测试。WOA与PWOAs之间的比较表明,提出的基于FPGA并行框架WOA异构平台维护固有优秀的全局收敛性。最重要的是,两个维度的增加和人口规模,提出算法的性能改善对于大多数基准测试函数除外 , ,和 ,这表明维度设置在一定程度上影响优化性能。一般来说,WOA的基准测试结果,PWOAs,全封闭,PSO证明的有效性两个平行WOA提出了这项工作。
关于运行时间,两个角度的函数类型和规模设置。从功能的角度类型,因为多峰函数( )算法的复杂性通常高于单峰函数( )(27,40),有一个明显的时间差距存在单峰和多峰函数优化算法在表中。对于经典算法,WOA和算法运行时间相对较近,特别是对于单峰函数。这是因为这两个算法本质上也有类似的结构和复杂性。方案,相反,保持更快的性能比WOA和PSO算法结构简单和低的社会发挥重要作用。PWOA-PPM和PWOA-AFPM而言,不同尺度的问题几乎没有对这两个算法的执行时间的影响。关于问题规模,这三种算法的运行时间是影响指标维度和人口规模没有例外。规范WOA是敏感的问题规模,不同规模的设置会导致在运行时间有很大的差距。PWOA-PPM,函数的执行时间的差异和是最小的,但显示了规模快速增长的趋势和 。相反,PWOA-PPM相对稳定的性能。随着规模的增加,它演示了一个缓慢增长的PWOA-PPM运行时间。
简而言之,该PWOA-PPM PWOA-AFPM执行比WOA更稳定,这受益于FPGA的硬件加速性能由于内置专用算术单元和模块化设计的管道。
5.3。加速效果分析
在本节中,加速计算基于运行时间不同的尺度问题,给出如下: 在哪里和表示串行WOA的运行时间和FPGA实现并行WOA,分别。
加速由PWOAs解决各种基准函数图所示7和分析如下。注意,PWOAs执行有一定程度的改善和加速PWOA-PPM和PWOA-AFPM在多峰函数优于在单峰函数尺度与所有问题。从图7(一)、单峰和多峰函数,搜索空间的维数越大,加速WOA-PPM获得比例越高。此外,WOA-PPM能明显加速,当解决最复杂的 ,和周围的最大加速达到18 x 。至于WOA-AFPM,它被发现在图7(b), WOA-AFPM展品不稳定的计算性能,在所有功能的加速减少的虽然表现相对更好的加速的情况下和 。此外,为优化WOA-AFPM获得的加速比 ,WOA-PPM相反,显示了一个轻微的下降趋势,随着问题规模的增加。产生的最大加速PWOA-AFPM可达10 x(解决与 )。
(一)
(b)
四条图,图中所示8,来直观地进行比较用于加速PWOA-PPM和PWOA-AFPM之间具有不同尺度的问题。在小范围内包括和 ,的加速PWOA-PPM不如PWOA-AFPM,特别是当解决的所有功能和 在的情况下 。但是请注意,PWOA-PPM稳步上升的运行效率随着规模的增加。在的情况下 ,所有单峰函数和WOA-PPM的加速比WOA-AFPM是大两倍或更多。这个值的差距加速WOA-PPM WOA-AFPM进一步从两次增加到2.5倍时解决在的情况下 。在几句话,WOA-PPM解决中型的和大型的问题有更多的优势,而WOA-AFPM在小规模的问题更好的计算性能。
(一)
(b)
(c)
(d)
从上面可以看出实验分析,与两个模型PWOAs不符影响加速度,这主要是由于不同的框架指导PWOA-PPM和PWOA-AFPM FPGA的实现异构平台。PWOA-PPM,利用部分并行模型和一定数量的额外的开销,CPU和FPGA之间频繁的交流成为一个瓶颈导致性能下降的小规模。不像PWOA-PPM PWOA-AFPM转移最WOA FPGA一边工作执行。此外,同步操作使用内存栅栏需要更多的硬件实现和内核性能可能会降低在FPGA身边55]。反过来,这使得PWOA-AFPM更加低效的增量基准问题的复杂性和规模。
6。结论
展示优秀的全局优化,WOA引起显著的研究兴趣在过去的几年里。不可避免的现实是,性能下降需要地方WOA当面对大规模复杂优化问题。存在许多建议来解决这个问题,其中大部分,然而,基于经典算法如遗传算法和粒子群优化,而很少有文献研究并行WOA可以找到。基于FPGA的加速器,本研究提出两个精心设计的并行模型来实现并行PWOA使用OpenCL框架与英特尔异构平台上演示。最后,两个并行模型的表现基于PWOA (PWOA-PPM和PWOA-AFPM)已使用10基准函数评估。
对于未来的工作,它是必不可少的将该算法应用于实际工程问题来验证实际的好处。除此之外,更多的不同类型的设备,如GPU和DSP需要调查,建立一个正如异构平台。这个平台将是一个有效的合作运行环境中高昂计算任务可以分解成几个部分,然后分配给不同的设备。因此,该并行方案具有潜在的实际应用。
数据可用性
使用的数据来支持本研究的结果包括在本文中。
的利益冲突
作者宣称没有利益冲突有关的出版。
确认
这项研究工作得到了国家重点研发项目批准号2018 yfb1700500,国家科学基金会中国批准号。52077213,62003332,61702493,广东省自然科学基金(没有。2018 a030310671),优秀青年创新基金深圳先进技术研究院研究员,中国科学院(没有。201822)。
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